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[2019年IEEE光子学与电磁学研究秋季研讨会（PIERS-Fall）- 中国厦门（2019.12.17-2019.12.20）] 2019光子学与电磁学研究秋季研讨会（PIERS-Fall）- 微波方法研究全介质超表面的共振特性

DOI：10.1109/PIERS-Fall48861.2019.9021327 出版年份：2019 更新时间：2025-09-19 17:13:59
摘要： 低密度奇偶校验（LDPC）分组码因其逼近香农极限的特性而成为主流前向纠错方案。然而要实现兼具低延迟与高吞吐量的LDPC解码器并非易事，传统方案通常依赖ASIC和FPGA技术来满足解码器设计约束。但随着图形处理器等并行架构的兴起以及CPU流式扩展技术的发展，多核与众核技术为新型编码设计中计算密集型原型开发阶段提供了专用LDPC解码器的灵活替代方案。本文综述了过去十年可编程LDPC解码器领域的重要研究成果，分析了并行架构与数据并行编程模型的优劣，并评估了针对底层编码特性及解码算法特征的设计空间探索方法。最后，本文总结了并行可编程可重构架构在通信系统领域尚未解决的关键问题。
作者： JOAO ANDRADE，GABRIEL FALCAO，VITOR SILVA，LEONEL SOUSA
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研究概述 实验方案

研究目的

调查过去十年中与可编程LDPC解码器相关的最重要出版物，评估并行架构和数据并行编程模型的优缺点，并探索与底层代码的关键特性及解码算法特征相关的设计空间。

研究成果

该调查得出结论：可编程低密度奇偶校验（LDPC）解码器，尤其是基于GPU和CPU实现的方案，为新编码设计原型阶段提供了灵活的替代方案。研究强调了数据并行与任务并行策略在实现高解码吞吐量和低延迟方面的重要性。论文同时指出了该领域现存问题，特别是关于在并行可编程及可重构架构上开发高效LDPC解码器的挑战。

研究不足

该调查仅限于可编程LDPC解码器，未广泛涵盖专用硬件解码器。同时重点关注采用高级综合模型为可重构架构开发的解码器，排除了使用传统RTL方法开发的解码器。

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