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短路应力对SiC功率MOSFET中SiO2介质退化的影响

DOI:10.1016/j.microrel.2018.07.144 期刊:Microelectronics Reliability 出版年份:2018 更新时间:2025-09-23 15:22:29
摘要: 本文研究了短路事件对平面SiC MOSFET栅极可靠性的影响,该影响随着结温升高和偏置电压增大而愈发显著。电学波形表明存在栅极退化机制,表现为栅极漏电流随退化程度加剧而持续增大。通过对退化SiC MOSFET进行失效分析,并与新器件结构对比以识别潜在缺陷/异常。聚焦离子束切割显示与新器件相比存在多处差异:(i)多晶硅栅极与铝源极间出现裂纹;(ii)源极接触附近存在金属颗粒;(iii)铝源极顶面发生形变。这些缺陷与栅极漏电流及漏极漏电流的增大具有相关性。
作者: Paula Diaz Reigosa,Francesco Iannuzzo,Lorenzo Ceccarelli
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研究概述 实验方案 设备清单

对在高温和额定电压下单应力短路操作下退化的1.2千伏平面碳化硅MOSFET进行失效分析,以了解栅极氧化层退化机制的根本原因。

平面SiC MOSFET的栅极可靠性在短路事件中会受到高结温与高偏置电压的影响,导致介质层开裂、金属颗粒产生以及源极金属化层改变,进而增大栅极和漏极漏电流。偏置电压对器件退化的作用不仅体现在临界能量方面,更具有显著影响。

该研究仅限于平面型SiC MOSFET器件及特定测试条件,未涵盖沟槽结构或其他器件类型。未对颗粒物进行材料分析,且裂纹的根本原因尚未完全明确。实验在栅极完全击穿前终止以便开展物理分析,可能未能捕捉全部失效模式。

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